2¼¼´ë 10³ª³ë±Þ(1y) 16Gbit DDR5 °³¹ß
¼¼°è ÃÖÃÊ JEDEC(±¹Á¦¹ÝµµÃ¼Ç¥ÁØÇùÀDZⱸ) ±Ô°Ý Àû¿ë
ºòµ¥ÀÌÅÍ, ÀΰøÁö´É, ¸Ó½Å·¯´× µî Â÷¼¼´ë ½Ã½ºÅÛ¿¡ ÃÖÀûÈ
DDR4 ´ëºñ Àü·Â ¼Ò¸ð 30% °¨Ãà, µ¥ÀÌÅÍ Àü¼Û ¼Óµµ 1.6¹è Çâ»ó,
ÇâÈÄ ½ÃÀå ¿¸®´Â 2020³âºÎÅÍ º»°Ý ¾ç»ê °èȹ
¡ã SKÇÏÀ̴нº°¡ °³¹ßÇÑ 2¼¼´ë 10³ª³ë±Þ(1y) DDR5 D·¥ |
SKÇÏÀ̴нº°¡ ¼¼°è ÃÖÃÊ·Î JEDEC(±¹Á¦¹ÝµµÃ¼Ç¥ÁØÇùÀDZⱸ) ±Ô°ÝÀ» Àû¿ëÇÑ DDR5 D·¥À» °³¹ßÇß´Ù. DDR5´Â DDR4¸¦ ÀÕ´Â Â÷¼¼´ë D·¥ Ç¥Áر԰ÝÀ¸·Î ºòµ¥ÀÌÅÍ, ÀΰøÁö´É, ¸Ó½Å·¯´× µî Â÷¼¼´ë ½Ã½ºÅÛ¿¡ ÃÖÀûÈµÈ ÃÊ°í¼Ó, ÀúÀü·Â, °í¿ë·® Á¦Ç°ÀÌ´Ù.
SKÇÏÀ̴нº´Â ÃÖ±Ù °³¹ßÇÑ 2¼¼´ë 10³ª³ë±Þ(1y) 8Gbit(±â°¡ºñÆ®) DDR4¿¡ ÀÌ¾î µ¿ÀÏÇÑ ¹Ì¼¼°øÁ¤À» Àû¿ëÇÑ 16Gbit DDR5µµ ÁÖ¿ä Ĩ¼Â ¾÷ü¿¡ Á¦°øÇÔÀ¸·Î½á ¾÷°è¸¦ ¼±µµÇÏ´Â ±â¼ú°æÀï·ÂÀ» È®º¸ÇÒ ¼ö ÀÖ°Ô µÆ´Ù.
ÀÌ Á¦Ç°Àº ÀÌÀü ¼¼´ëÀÎ DDR4 ´ëºñ µ¿ÀÛ Àü¾ÐÀÌ ±âÁ¸ 1.2V¿¡¼ 1.1V·Î ³·¾ÆÁ® Àü·Â ¼Òºñ·®ÀÌ 30% °¨ÃàµÆ´Ù. Àü¼Û ¼Óµµ´Â 3200Mbps¿¡¼ 5200Mbps·Î 1.6¹è°¡·® Çâ»óµÆ´Ù. ÀÌ´Â FHD(Full-HD)±Þ ¿µÈ(3.7GByte) 11Æí¿¡ ÇØ´çµÇ´Â 41.6GByte(±â°¡¹ÙÀÌÆ®)ÀÇ µ¥ÀÌÅ͸¦ 1ÃÊ¿¡ ó¸®ÇÒ ¼ö ÀÖ´Â ¼öÁØÀÌ´Ù.
À̹ø¿¡ Ĩ¼Â ¾÷ü¿¡ Á¦°øµÈ Á¦Ç°Àº ¼¹ö¿Í PC¿ë RDIMM(Registered Dual In-line Memory Module)°ú UDIMM(Unbuffered DIMM)À¸·Î JEDEC DDR5 Ç¥ÁØ¿¡ ¸ÂÃç µ¥ÀÌÅ͸¦ ÀúÀåÇÏ´Â ¼¿ ¿µ¿ªÀÇ ´ÜÀ§ °ü¸® ±¸¿ªÀ» 16°³ ¿¡¼ 32°³·Î È®ÀåÇÏ°í(16bank → 32bank) ÇÑ ¹ø¿¡ ó¸®ÇÏ´Â µ¥ÀÌÅÍÀÇ ¼öµµ 8°³¿¡¼ 16°³(BL8 → BL16)·Î ´Ã·È´Ù. ¶ÇÇÑ Ä¨ ³»ºÎ¿¡ ¿À·ùÁ¤Á¤ ȸ·Î(Error Correcting Code)¸¦ ³»ÀåÇÏ°í ÀÖ¾î °í¿ë·® ½Ã½ºÅÛÀÇ ½Å·Ú¼ºÀ» ȹ±âÀûÀ¸·Î ³ôÀÏ °ÍÀ¸·Î ±â´ëµÈ´Ù.
ÃÊ°í¼Ó µ¿ÀÛ Æ¯¼ºÀ» È®º¸Çϱâ À§ÇÑ ±â¼úµéµµ Àû¿ëµÆ´Ù. D·¥ÀÇ Àбâ/¾²±â ȸ·Î¸¦ ÃÖÀûÀÇ »óÅ·ΠÁ¶Á¤ÇÏ´Â °í¼Ó Æ®·¹ÀÌ´× ±â¼ú(high speed training scheme), Àü¼Û ÀâÀ½À» Á¦°ÅÇÏ´Â DFE(Decision Feedback Equalization), ¸í·É¾î ¹× µ¥ÀÌÅÍ Ã³¸®¸¦ º´·ÄÈÇϱâ À§ÇÑ 4ÆäÀÌÁî Ŭ·ÎÅ·(4phase clocking), Àб⠵¥ÀÌÅÍÀÇ ¿Ö°îÀ̳ª ÀâÀ½À» ÃÖ¼ÒÈÇϱâ À§ÇÑ ÀúÀâÀ½/°í¼º´É DLL(Delay locked loop) ¹× DCC(Duty Cycle Correction)ȸ·Î µî ½Å±â¼úÀÌ Ã¤¿ëµÅ DDR4ÀÇ ´ëºñ µ¥ÀÌÅÍ Ã³¸® ¼Óµµ°¡ Å©°Ô °³¼±µÆ´Ù.
SKÇÏÀ̴нº D·¥ °³¹ß»ç¾÷ VPD´ã´ç Á¶ÁÖȯ »ó¹«´Â “¼¼°è ÃÖÃÊ·Î JEDEC Ç¥ÁØ ±Ô°ÝÀÇ DDR5 D·¥ Á¦Ç°À» ¸¸µç ±â¼ú °æÀï·ÂÀ» ±â¹ÝÀ¸·Î DDR5 ½ÃÀåÀÌ ¿¸®´Â 2020³âºÎÅÍ º»°Ý ¾ç»êÀ» °³½ÃÇØ °í°´ ¼ö¿ä¿¡ Àû±Ø ´ëÀÀÇÒ °èȹ”À̶ó°í ¸»Çß´Ù.
ÇÑÆí ½ÃÀåÁ¶»ç±â°ü IDC´Â 2020³âºÎÅÍ DDR5 ¼ö¿ä°¡ º»°ÝÀûÀ¸·Î ¹ß»ýÇϱ⠽ÃÀÛÇØ 2021³â¿¡´Â Àüü D·¥ ½ÃÀåÀÇ 25%, 2022³â¿¡´Â 44%·Î Áö¼Ó È®´ëµÉ °ÍÀ¸·Î ¿¹»óÇß´Ù.
¡Ø ¿ë¾î ¼³¸í ¹ðÅ©(Bank) ¢º µ¥ÀÌÅ͸¦ ±¸ºÐÇÏ¿© ÀúÀåÇÒ ¼ö ÀÖ´Â ´ÜÀ§À̸ç, µ¶¸³ÀûÀ¸·Î È°¼ºÈ ¶Ç´Â ºñÈ°¼ºÈ ÇÒ ¼ö ÀÖÀ½. È°¼ºÈ µÇ¾î ÀÖ´Â °¢ ¹ðÅ©ÀÇ µ¥ÀÌÅÍ´Â ¿¬¼ÓÀûÀ¸·Î Àбâ¿Í ¾²±â µ¿ÀÛÀÌ °¡´ÉÇÔ. BL(Burst Length) ¢º D·¥¿¡¼ ÇÑ ¹øÀÇ Àбâ/¾²±â ¸í·É¿¡ µû¶ó ¿¬¼ÓÀ¸·Î ÀÔÃâ·ÂµÇ´Â µ¥ÀÌÅÍÀÇ °³¼ö °í¼Ó Æ®·¹ÀÌ´× ±â¼ú(High speed training scheme) ¢º ½Ã½ºÅÛ ±âµ¿ ½Ã Àбâ/¾²±â ȸ·Î¸¦ °í¼Ó »óÅ¿¡¼ ÃÖÀûȵǵµ·Ï ¹Ì¼¼ÇÏ°Ô Á¶Á¤ÇÏ´Â ¹æ½Ä DFE(Decision Feedback Equalization) ¢º ä³ÎÀÇ °í¼Ó µ¿ÀÛ ½Ã ¹ß»ýÇÏ´Â ¹Ý»ç ÀâÀ½À» Á¦°Å Çϴ ȸ·Î ±â¼ú DLL(Delay Locked Loop) ¢º D·¥ÀÇ Ãâ·Â µ¥ÀÌÅ͸¦ ¿ÜºÎ Ŭ·Ï¿¡ Á¤È®ÇÏ°Ô µ¿±âÈ ½ÃÄÑ Àü¼ÛÇϴ ȸ·Î ±â¼ú DCC(Duty Cycle Correction) ¢º ¿¬¼ÓµÇ´Â Ŭ·Ï ¶Ç´Â µ¥ÀÌÅÍ ½ÅÈ£ÀÇ ÇÏÀÌ ÆÞ½º¿Í ·Î¿ì ÆÞ½ºÀÇ ÆøÀ» 50:50À¸·Î ¸ÂÃߴ ȸ·Î ±â¼ú |
ÀÌõÀú³Î icjn2580@hanmail.net